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Es wird als 12M-Serie bezeichnet und bietet außerdem 2, 6 MBit Embedded-Speicher und eine Systemtaktleistung von 200 MHz.

Strukturierte Asics sind eine flexiblere Alternative zum kundenspezifischen Design. Sie sollen die Time-to-Market verkürzen und die NRE-Kosten senken. Laut Angaben des Anbieters hat die Umstellung auf 0, 15 μm zu einer Geschwindigkeitsverbesserung von 50 Prozent und einer Halbierung des Stromverbrauchs im Vergleich zu früheren 0, 25 μm-Geräten geführt.

In der Regel sind strukturierte Asics auf Produktdesign mit moderaten Stückzahlen zwischen 1.000 und 500.000 Einheiten ausgerichtet.

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Das strukturierte Asic-Design basiert auf einer Reihe vordefinierter Schaltungselemente (Slices), wodurch die Flexibilität im Vergleich zu herkömmlichen Schaltungen erreicht wird. NEC hat 10 Slices mit vorverteilten Dual-Port-Speicherblöcken und analogen Phasenregelkreisen (PLLs) eingeführt, die in ein hochdichtes strukturiertes Logikarray eingebettet sind.

DLL-Blöcke (Digital Delay Locked Loop) werden in den größeren Slices verteilt. Die E / A-Ports unterstützen mehrere Standards, einschließlich LVTTL, PCI, PCI-X, GTL +, LVCMOS2.5, SSTL3, SSTL2, HSTL, LVDS, LVPECL (Eingabe).

Die strukturierte Asic-Serie CMOS-12M bietet kleine bis mittelgroße Slices mit 125.000 bis zwei Millionen verwendbaren Gates und einem eingebetteten Speicher von 98 KBit bis 2, 6 MBit.

Ein weiterer Asic-Anbieter, LSI Logic, sagte, dass seine strukturierte Asic-Familie, bekannt als RapidChip, sein Geschäft geändert hat, da das Design für vollständig kundenspezifische Geräte rückläufig ist und die Prozesstechnologie die Kosten und Entwicklungszyklen erhöht.

Diese Sicht auf den Asic-Markt ist aggressiver als die anderer Unternehmen. Gary Meyers vom Software-Tool-Unternehmen Synplicity hat Electronics Weekly mitgeteilt, dass die Anzahl der Asic-Design-Starts für Standardzellen innerhalb von fünf Jahren unter 1.000 pro Jahr sinken wird. Auch in diesem Zeitraum werde die Anzahl der strukturierten Asics 1.000 überschreiten, behauptete er.