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Zu den Logikbibliotheken gehören Hochleistungs- und Standardzellenbibliotheken mit hoher Dichte, Power-Management-Kit- und Eco-Kit-Bibliothekserweiterungen, die laut Angaben des Unternehmens darauf abzielen, „die Leckageprobleme von Submikrometer-Designs anzugehen“.

„Alle Bibliotheken mit mehreren Kanälen sind mit dem Footprint kompatibel und ermöglichen ein müheloses Austauschen von Zellen innerhalb der Standarddesignabläufe. Dies ermöglicht signifikante Energie- und Kosteneinsparungen, indem die HVt-, RVt- oder LVt-Implantatschichten durch Geräte mit langer Kanallänge ersetzt oder ergänzt werden, wodurch eine bessere Leistung, geringere Leckage und geringere Herstellungskosten erzielt werden “, so ARM.

Siehe TSMC betreibt die ersten 40-nm-Wafer für AMD, Altera und Nvidia

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ARM hat die 40-nm-Schnittstellen-IP eingeführt, die für die Bereitstellung von Allzweck-E / A-, Spezial-E / A- und DDR-Schnittstellenmakros erforderlich ist.

Die IP-Schnittstelle enthält mehrere Strom- und Leckagemodi, die dynamisch gesteuert werden können, um die gesamte SoC-Leistung weiter zu optimieren und eine bessere Granularität der Leistungsprofile zu ermöglichen.

Beispielsweise ermöglicht die IP-Schnittstelle unter Verwendung der üblichen ESD- und Power-Rail-Entwurfsmethode die Integration von Pad-Ringen, wodurch das Zuverlässigkeitsrisiko verringert werden kann.

„Durch unsere strategische Beziehung zu TSMC können wir das physische Design mit der Herstellungsprozesstechnologie optimieren, um optimale Ergebnisse zu erzielen“, sagte Simon Segars, Executive Vice President und General Manager der Physical IP Division von ARM.